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更新于 8月15日
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數(shù)字前端設(shè)計(jì)工程師

2.5-5萬·14薪
  • 北京海淀區(qū)
  • 5-10年
  • 本科
  • 全職
  • 招10人

職位描述

Verilog邏輯綜合時(shí)序分析國(guó)密算法高性能芯片數(shù)字前端設(shè)計(jì)Synopsys數(shù)字前端驗(yàn)證

工作內(nèi)容:
1.根據(jù)設(shè)計(jì)需求，完成芯片系統(tǒng)架構(gòu)或IP模塊設(shè)計(jì)方案及相關(guān)文檔；

2. 完成系統(tǒng)或模塊的RTL設(shè)計(jì)、仿真、綜合、時(shí)序驗(yàn)證等工作，并滿足功能、性能要求；

3. 配合模擬工程師完成系統(tǒng)集成工作；

4. 配合后端工程師完成設(shè)計(jì)實(shí)現(xiàn)，保證流片質(zhì)量；

5. 制定測(cè)試方案，對(duì)芯片樣片進(jìn)行測(cè)試評(píng)估，分析和解決評(píng)測(cè)問題。

任職資格:
1.電子、微電子相關(guān)專業(yè)碩士以上學(xué)歷；
2.扎實(shí)的數(shù)字集成電路專業(yè)知識(shí)，熟練掌握Verilog HDL，熟悉IC設(shè)計(jì)相關(guān)流程；

3.熟悉ARM體系架構(gòu)和AMBA總線，具備SoC系統(tǒng)設(shè)計(jì)經(jīng)驗(yàn)；
4.熟練使用相關(guān)EDA工具，包括VCS、DC、Formality、Prime Time等；
5.有較強(qiáng)的邏輯思維能力、良好的溝通能力；


職位福利：五險(xiǎn)一金、帶薪年假、包吃、補(bǔ)充醫(yī)療保險(xiǎn)、定期體檢、14薪、健身俱樂部、彈性工作

工作地點(diǎn)

中關(guān)村東升科技園

職位發(fā)布者

宋女士/hr

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