更新于 2月21日

FPGA開發(fā)工程師

2.5-4萬(wàn)
  • 廣州黃埔區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招1人

職位描述

Verilog HDLDDRGENLOCK

崗位職責(zé) :

1. 負(fù)責(zé)高速存儲(chǔ)接口(如DDR4、PCIe)的設(shè)計(jì)與實(shí)現(xiàn);

2. 負(fù)責(zé)視頻圖像采集輸入輸出系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),如MIPI,LVDS等;

3. 負(fù)責(zé)開發(fā)多設(shè)備同步系統(tǒng),確保多設(shè)備間的時(shí)鐘和幀同步;

4. FPGA邏輯設(shè)計(jì)、仿真、調(diào)試和優(yōu)化。

任職要求 :

1. 本科及以上學(xué)歷,電子工程、通信工程、計(jì)算機(jī)等相關(guān)專業(yè);

2. 熟練掌握Verilog/VHDL語(yǔ)言,熟悉Xilinx/Intel FPGA開發(fā)工具;

3. 具備高速接口開發(fā)經(jīng)驗(yàn)(如DDR、PCIe、MIPI等);

4. 熟悉時(shí)鐘同步機(jī)制(如GENLOCK、PLL);

5. 有圖像處理或傳感器接口開發(fā)經(jīng)驗(yàn)者優(yōu)先;

6. 具備良好的團(tuán)隊(duì)協(xié)作能力和問題解決能力。

加分項(xiàng) :

1. 有視頻處理或工業(yè)相機(jī)相關(guān)項(xiàng)目經(jīng)驗(yàn);

2. 熟悉嵌入式系統(tǒng)開發(fā)(如ARM+FPGA架構(gòu))。


工作地點(diǎn)

廣州市黃埔區(qū)科學(xué)城開源大道11號(hào)A5棟2、3樓

職位發(fā)布者

博冠BOSMA/HR

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